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使用有安全保障的閃存存儲構建安全的汽車系統

使用有安全保障的閃存存儲構建安全的汽車系統

在現代汽車嵌入式系統中，高度安全的數據存儲是必不可少的，尤其是在面對日益高明的網絡攻擊時。本文將介紹設計師正確使用閃存的步驟。

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20 kHz脈沖偏壓控制系統設計[電源技術][其他]

為提高電子束熔絲增材的成形質量，基于偏壓調節束流的原理，開發了一種20 kHz脈沖偏壓控制系統。通過對其工作環境深入分析，選取高速DSP數字處理芯片實現脈沖束流基值、峰值向偏壓基值、峰值的轉化，根據輸入脈沖頻率、占空比，可以調節脈沖束流的輸出；并通過PWM發生芯片，輸出100 kHz以上的基波，由DSP輸出脈沖合成的模式，再經由大功率運放、基值、峰值串聯整流電路可以獲得脈沖偏壓輸出，繼而實現對脈沖束流輸出的調控，從而獲得一熔滴一脈沖的熔絲成形效果。

發表于：8/31/2021

諧振高壓等離子球磨電源研究[電源技術][其他]

等離子輔助球磨技術需要高壓電源激發等離子場，而目前高壓等離子球磨電源存在開關管數目多、控制時序復雜、可靠性低等問題。研制了采用單管結構的諧振高壓等離子球磨電源。首先介紹了主電路的工作原理，詳細分析了初級諧振網絡的固有諧振頻率及諧振參數選擇；利用變壓器與負載的串聯諧振網絡進一步提高輸出電壓幅值；通過Simulink仿真，驗證了主電路工作波形以及諧振電壓增益，其輸出電壓峰峰值可達到24 kV以上。在此基礎上，研制了一臺輸出功率3 kW樣機，并成功激發等離子場用于輔助球磨。

發表于：8/31/2021

基于HDMIRx CEC的電視待機喚醒方案的軟件設計[其他][消費電子]

為減少在TV待機喚醒場景下遙控器的使用次數，且滿足低功耗的需求，在分析CEC1.4協議的基礎上，使用CPU與MCU協同工作的方式設計了一種HDMI_CEC待機喚醒軟件實現方案，并在單板上實現了方案中描述的具體功能。最后使用SL309儀器對實際功能進行了驗證。從驗證的結果來看，其完全符合TV待機喚醒的要求。該方案為低功耗場景下的TV待機喚醒提供了方法與思路。

發表于：8/31/2021

基于FPGA的相控陣天線波束控制算法優化研究[其他][其他]

目前FPGA是開發波束控制系統的首選控制芯片，但FPGA在計算浮點數據時存在耗時長并且資源占用大的問題，對波束控制算法的實現存在一定限制。基于此提出一種查表與FPGA計算相結合的優化型波束控制算法，以8×8矩形相控陣天線為控制對象，詳細介紹了該優化型算法以及FPGA算法模塊的邏輯設計，優化型算法降低FPGA資源占用率，節約系統功耗的同時又規避了FPGA難以計算三角函數的問題，最后基于Vivado/Xsim搭建仿真平臺，仿真與測試結果證明了該方案的正確性和高效性。

發表于：8/31/2021

基于STM32的大功率LED陣列高精度制冷控制系統[其他][其他]

LED結溫動態嚴重影響其光學特性變化規律，針對大功率LED陣列散熱需求，利用半導體制冷器(Thermoelectric Cooler，TEC)設計一套制冷控制系統。開關電源易產生較強電磁干擾，設計具有快響應時間、高穩定度特點的可編程線性電源驅動TEC穩定工作。針對常規線性PID對具有非線性特征的TEC制冷控制系統存在快速性和超調量難以兼得的問題，于STM32嵌入式實現模糊RBF神經網絡PID控制，并用6×3 W大功率LED陣列進行測試，實驗結果證明相比于常規線性PID控制，調節時間縮短，超調量減少，溫度波動僅為±0.1 ℃，該系統在保持大功率LED陣列工作環境溫度穩定的同時可提升其輸出光效。

發表于：8/31/2021

高吞吐率低時延圖像DCT處理器設計[其他][其他]

針對高分辨率、高幀率圖像實時壓縮問題，設計了一種應用于高速圖像JPEG壓縮編碼系統的離散余弦變換(DCT)處理器。設計的DCT處理器基于Virtex-7系列FPGA，充分利用并行和流水線處理技術，采用基于蝶形流圖結構的行列分解算法，實現了快速二維離散余弦變換(2D-DCT)。為了提高數據吞吐率，設計了雙核DCT處理單元，可同時處理16個像素，從整體上提高處理速度和降低時延。板級測試表明，高速圖像DCT處理器數據計算結果正確，在200 MHz系統時鐘下，吞吐率高達3 GB/s，此時平均每幀圖像處理時間不超過10 ms，實現了高速圖像的實時處理。

發表于：8/31/2021

一種面向智能網絡系統的自主計算能力分析方法[其他][其他]

目前各類智能網絡系統已被廣泛地應用，但是由于節點眾多、外部環境復雜，自我管理具有很大挑戰。而自主計算系統(ACS)具有根據策略和目標實現自主管理的能力，在復雜的智能網絡系統中具有廣闊的應用前景。然而，目前自主計算的評價方法缺乏準確的量化來評估ACS的自我管理水平。首先提出了基于PEPA(Performance Evaluation Process Algbra)的自主計算評價模型。然后，根據自主計算的核心思想(較少或無人干預)提出了一種自我管理的評價指標。此外，為了避免ACS的巨大規模導致傳統馬爾可夫鏈的狀態空間爆炸，采用連續狀態空間近似方法從PEPA模型中生成 ODEs(Ordinary Differential Equations)。實驗結果表明，提高檢測成功率和self-*變遷速率對提高自主計算具有重要意義，為自主計算提供了一種評價方法，可以自動測量自我管理的能力。

發表于：8/31/2021

具有固定長度密文的廣播加密方案[其他][其他]

廣播加密方案可建立一對多的密態數據傳輸通道，消息發送者可在執行加密操作前創建授權用戶集合，惟有授權用戶才能對接收到的廣播密態數據進行解密。利用素數階非對稱雙線性映射構造了標準模型下靜態安全的公鑰廣播加密方案，密文擴展量與用戶密鑰擴展量為O(1)，公鑰擴展量為O(N)(N表示廣播加密系統內用戶總數)。與之前相關方案相比，該方案能夠在簡單的非交互式安全假設下取得標準模型下靜態安全性，并且取得最優化的密文與用戶密鑰擴展量。

發表于：8/31/2021

面向OSD語言檢測對照表的匹配定位算法[其他][其他]

OSD語言自動化檢測系統需要將識別輸出與標準對照表進行比對來確定最終結果，關鍵就在于能否實現精確匹配定位。因此，對經典的單模式匹配BM算法和多模式匹配AC算法分析研究，結合Excel表的編碼方式和特點，提出了一種針對Excel表的精準匹配定位算法。該算法利用Excel表成行成列的使用特點，將表格單列內容以三行并一組方式組合，根據三行總字數N和中間行字數M進行分類，利用單模式匹配方法進行匹配定位。分析驗證表明，該算法相對于BM算法、AC算法匹配次數更少，定位精確度更高。

發表于：8/31/2021

基于證據理論的特征值之比協作頻譜感知算法[其他][其他]

針對單節點頻譜感知容易受到多徑效應、隱蔽終端、路徑損耗等因素影響，提出了一種基于證據理論的特征值之比協作頻譜感知算法。該算法以特征值之比檢測法作為本地感知結果，通過基礎概率分配(BPA)函數計算出可信度發送給融合中心，融合中心根據D-S證據理論融合規則進行數據融合與判決。仿真結果表明,該算法對比于相關算法，在一定程度上抵抗惡意攻擊性能，具有較高的安全性，在低信噪比的環境下或者虛警概率高于0.6的環境下時，該算法的檢測概率更加突出，并且該算法還具有較高能效。

發表于：8/31/2021

基于單因素方差分析的密碼算法統計檢驗[其他][其他]

在密碼學范疇中，隨機序列常作為密鑰、初始向量或算法參數使用。隨機序列的隨機性最終決定了整個密碼系統的安全性，因此在密碼技術中占有重要位置。對于良好的密碼算法產生的密文序列，應無法通過統計學方法進行區分。首先對7種經典密碼算法生成的密文序列進行NIST隨機性檢驗，統計失敗次數；然后關于密碼算法進行單因素方差分析，檢驗結果在統計學上無顯著差異。此統計檢驗可作為評價密碼算法好壞的指標之一。

發表于：8/31/2021

基于無線通信的智能家居設計[通信與網絡][物聯網]

隨著科技的迅速發展以及物聯網時代的到來，人們對居住的環境也有了更高要求，智能家居技術日新月異。提出一款結合STM32開發平臺和中國移動云平臺的無線通信智能家居設計，相比傳統智能家居，本設計采用串口、Wi-Fi相結合的方式，擺脫了有線傳輸的復雜性，通過MATLAB對監控到的數據采用歸一化算法分析，用戶可通過云平臺實時監控傳感信息，實現對家庭設備的智能控制。

發表于：8/31/2021

基于平移窗運動想象腦電信號活動段提取[其他][其他]

為了迅速、準確地識別運動想象的腦電信號，提出了一種基于平移窗的運動想象腦電信號活動段提取方法。該方法對運動想象腦電信號Mu/Beta節律的事件相關同步化/去同步化(ERS/ERD)特征進行檢測，提取ERS/ERD特征明顯的時段；再利用統計量進行特征提取，通過Classify分類器進行信號分類。利用2003年BCI競賽data set Ⅲ進行測試，分類準確率達到83.571 4%。該方法可以評價受試者的腦活動狀態，提高運動想象腦電信號的識別準確率，對腦-機接口實時控制系統的研究有一定的幫助。

發表于：8/31/2021

低噪聲低功耗3階復數濾波器的設計[其他][其他]

采用UMC 40 nm CMOS工藝，設計了一款低噪聲低功耗的3階復數濾波器。利用FLFB(Follow-the-Leader-Feedback)結構良好的噪聲特性，并以勞斯-霍爾維茨穩定性判據為理論依據，采用相位裕度僅為36.8°的運放，達到低噪聲低功耗的優化目的。仿真結果表明：濾波器的帶寬可調范圍為0.98～1.92 MHz，中心頻率0.68～1.34 MHz可調，通帶內噪聲90.6 μV，無雜散動態范圍73.7 dB，鏡像抑制比28.4 dB，此時總功耗為1.33 mW。

發表于：8/31/2021

一種帶有DAC失配整形的高精度Sigma-Delta調制器[其他][其他]

為減小生理信號采集應用中儀表放大器的設計難度，需在低功耗、小信號帶寬的前提下大幅度提高模數轉換單元的精度和動態范圍以作補償。為此，面向生理信號采集應用，實現了一種帶前饋結構的高精度三階五比特Sigma-Delta調制器，其不需要復雜的OTA結構和過高的過采樣率，且功耗較低，并將二階噪聲整形動態元件匹配方案應用于DAC中，以避免多比特量化造成的非線性諧波失真。該Sigma-Delta調制器采用SMIC 0.18 μm CMOS標準工藝，在1 MHz的采樣率，1 kHz的信號帶寬內，峰值SNDR達到111 dB，動態范圍達到120 dB，有效位數達到18 bit，工作電源電壓為1.8 V，整體功耗為0.87 mW。

發表于：8/31/2021

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