| 基于FPGA的圖像處理電路的設(shè)計(jì)與實(shí)現(xiàn) | |
| 所屬分類(lèi)：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大?。?span>239 K | |
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| 文檔介紹：以FPGA為平臺(tái),設(shè)計(jì)了灰階變化、圖像壓縮、邊緣檢測(cè)等圖像處理電路.與傳統(tǒng)的設(shè)計(jì)方法相比較,本設(shè)計(jì)不僅具有FPGA電路特有的開(kāi)發(fā)周期短、設(shè)計(jì)效率高、擴(kuò)展性和升級(jí)性良好、設(shè)計(jì)靈活等特點(diǎn),而且由于系統(tǒng)采用硬件電路實(shí)現(xiàn),因此在圖像處理的速度上具有明顯的優(yōu)勢(shì). | |
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