| 基于FPGA的動(dòng)態(tài)目標(biāo)跟蹤系統(tǒng)設(shè)計(jì) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大?。?span>288 K | |
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| 文檔介紹：為了解決基于PC機(jī)的視頻動(dòng)態(tài)目標(biāo)跟蹤實(shí)時(shí)性瓶頸問(wèn)題,設(shè)計(jì)出一種基于FPGA的動(dòng)態(tài)目標(biāo)跟蹤系統(tǒng)。設(shè)計(jì)遵循圖像處理金字塔模型,針對(duì)低層和中層算法簡(jiǎn)單、數(shù)據(jù)量大且存在一定并行性等特點(diǎn)采用FPGA硬件實(shí)現(xiàn),而高層較復(fù)雜算法使用Nios Ⅱ軟核進(jìn)行C語(yǔ)言編程。整個(gè)設(shè)計(jì)采用Verilog-HDL對(duì)算法完成建模與實(shí)現(xiàn),并在QUARTUS Ⅱ上進(jìn)行了綜合、布線等工作,最后以Altera公司的DE2開(kāi)發(fā)板為硬件平臺(tái)實(shí)現(xiàn)了整個(gè)系統(tǒng)。 | |
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