基于FPGA的剩余電壓檢測系統的設計
所屬分類:參考設計
上傳者:aet
文檔大小:521 K
標簽: 剩余電壓 絕對值電路 采樣保持
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文檔介紹:提出了一種高準確度低功耗的剩余電壓檢測方法。該測量裝置通過過零檢測電路獲取工頻同步信號,在工頻交流峰值時刻切斷待測設備的電源,由高輸入阻抗的輸入回路對待測設備的剩余電壓進行取樣;在NiosII的控制下,采用高速采樣保持電路和高精度模數轉換器實現設備掉電1 s和10 s后剩余電壓的在線檢測。實驗證明該測量裝置有較好的穩定性,測量準確度達到0.506%,滿足測量要求。
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