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銀湖資本完成對Altera的51%股權(quán)收購

銀湖資本完成對Altera的51%股權(quán)收購

北京時(shí)間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對 Altera 51% 股權(quán)的收購，該股權(quán)原由英特爾公司持有。同時(shí)，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對 Altera 未來良好發(fā)展充滿信心。

一種應(yīng)用于生物識別領(lǐng)域的AES算法

生物識別技術(shù)已廣受重視，利用AES加密算法對生物識別過程中的特征模板進(jìn)行加密可以大大提高生物識別技術(shù)的安全性。為提高AES加密算法的吞吐率，使其更好地應(yīng)用于生物識別領(lǐng)域，以FPGA為實(shí)現(xiàn)主體，采用串行緩存結(jié)構(gòu)，充分利用FPGA并行處理的特點(diǎn)，成功實(shí)現(xiàn)了一種大吞吐量的AES算法。最后在Xilinx的XC7A200T芯片上對算法進(jìn)行了驗(yàn)證，經(jīng)計(jì)算其理論吞吐量可以達(dá)到30.3 Gb/s。

發(fā)表于：7/27/2015

基于安路FPGA的雙端口千兆以太網(wǎng)視頻傳輸卡

本文介紹了一種使用ANLOGIC(上海安路信息科技有限公司) AL3 FPGA實(shí)現(xiàn)的基于千兆以太網(wǎng)的實(shí)時(shí)視頻傳輸系統(tǒng)。本文首先對AL3 FPGA的特點(diǎn)，KSZ9031RNX千兆PHY芯片和視頻傳輸帶寬計(jì)算等進(jìn)行了簡要介紹，然后詳細(xì)描述了系統(tǒng)硬件架構(gòu)和FPGA程序架構(gòu)，通過采用乒乓式的頁模式訪問SDRAM解決視頻緩存帶寬瓶頸，實(shí)現(xiàn)了1080P 30幀/秒的實(shí)時(shí)視頻傳輸。

發(fā)表于：7/27/2015

2015 Altera亞洲創(chuàng)新設(shè)計(jì)大賽獲獎(jiǎng)名單

經(jīng)過激烈的角逐，2015亞洲創(chuàng)新設(shè)計(jì)大賽共評選出特等獎(jiǎng)4名、一等獎(jiǎng)6名、二等獎(jiǎng)4名，三等獎(jiǎng)6名。其中，湖北大學(xué)的“30秒速解魔方機(jī)器人”在公投環(huán)節(jié)以兩票領(lǐng)先的優(yōu)勢當(dāng)選本屆亞洲創(chuàng)新設(shè)計(jì)大賽的兩岸總冠軍。

發(fā)表于：7/25/2015

2015 Altera亞洲創(chuàng)新設(shè)計(jì)大賽完美收官

7月11日～12日，由Altera和友晶科技聯(lián)合主辦的2015亞洲創(chuàng)新設(shè)計(jì)大賽終于在武漢落下帷幕。本屆大賽吸引了500多支隊(duì)伍報(bào)名參賽，通過分賽區(qū)的比拼，最后共有16支隊(duì)伍帶著他們的精彩作品來到現(xiàn)場，參加最后的角逐。

發(fā)表于：7/25/2015

基于粒子群算法的交通干線協(xié)調(diào)控制的研究

目前各大城市交通擁堵的一個(gè)重要原因是交通控制仍然為單點(diǎn)控制，未能實(shí)現(xiàn)協(xié)調(diào)優(yōu)化。基于此，提出一種基于粒子群優(yōu)化的干線交通總延誤最小協(xié)調(diào)控制方法。首先，通過對城市交通干線協(xié)調(diào)控制進(jìn)行數(shù)學(xué)抽象，建立干線交通雙向綠波控制總延誤模型。其次，依據(jù)總延誤模型的特征，設(shè)計(jì)了一種利用歷史最優(yōu)共享的粒子群算法(VSHBPSO)。接著，對干線總延誤模型進(jìn)行優(yōu)化，以總延誤最小為目標(biāo)，得出相位差、綠信比的最優(yōu)解，進(jìn)而獲得交通信號相位的動(dòng)態(tài)配時(shí)策略。最后以秦皇島市交通干線為例進(jìn)行仿真實(shí)驗(yàn)，實(shí)驗(yàn)結(jié)果表明，優(yōu)化后的交叉口配時(shí)方案比傳統(tǒng)的定時(shí)控制方案減少了43.1%的延誤時(shí)間，有效提高了干線通行效率。

發(fā)表于：7/23/2015

基于FPGA的通用PCM測試系統(tǒng)設(shè)計(jì)

遙測系統(tǒng)中，使用大量、種類繁多的數(shù)據(jù)綜合設(shè)備將不同種類、不同通道的有用信息綜合、編碼為PCM流。為滿足種類繁多的數(shù)據(jù)綜合設(shè)備的測試需求，研制了基于FPGA的通用PCM測試系統(tǒng)，實(shí)現(xiàn)對具有不同碼型、碼速率、幀結(jié)構(gòu)以及接口等的數(shù)據(jù)綜合設(shè)備的功能測試。系統(tǒng)功能強(qiáng)大，使用靈活方便。

發(fā)表于：7/23/2015

基于FPGA的數(shù)字高清CMOS遙感成像技術(shù)

為得到高質(zhì)量的數(shù)字高清遙感圖像，設(shè)計(jì)了一種基于FPGA的CMOS遙感成像系統(tǒng)。首先闡述了以FPGA為主處理器的硬件平臺結(jié)構(gòu)，然后從模塊化的角度詳細(xì)介紹了如何用FPGA器件實(shí)現(xiàn)硬件系統(tǒng)的數(shù)字功能并得到高質(zhì)量的遙感圖像，這些內(nèi)容主要包括主控制接口、傳感器接口、圖像預(yù)處理、DDR2控制、數(shù)字視頻合成等模塊。通過軟件仿真和硬件測試，驗(yàn)證了設(shè)計(jì)方案的正確性和有效性。

發(fā)表于：7/23/2015

基于FPGA的電子變焦系統(tǒng)設(shè)計(jì)

針對數(shù)碼相機(jī)、手機(jī)等移動(dòng)設(shè)備的特點(diǎn)，提出一種基于高分辨率傳感器的無損電子變焦模型，該模型同時(shí)克服了光學(xué)變焦模型和傳統(tǒng)電子變焦模型的缺陷，輸出圖像可以達(dá)到光學(xué)變焦的效果。針對圖像在縮放過程中的混疊現(xiàn)象，提出一種基于FPGA的抗混疊濾波和雙線性插值相結(jié)合的圖像縮放算法。通過MATLAB仿真表明，該算法得到的圖像質(zhì)量較高,硬件實(shí)現(xiàn)簡單。

發(fā)表于：7/23/2015

基于DSP+CPLD的電動(dòng)舵機(jī)控制系統(tǒng)的設(shè)計(jì)

設(shè)計(jì)了一個(gè)基于DSP+CPLD的電動(dòng)舵機(jī)控制系統(tǒng)。硬件電路包括控制器、驅(qū)動(dòng)電路、信號檢測電路以及保護(hù)電路，完成了對各部分電路的檢測，同時(shí)采用了PI控制算法，并對參數(shù)進(jìn)行了調(diào)整。采用DSP和CPLD相結(jié)合的主控單元，簡化了DSP的外圍電路，減少了DSP消耗的運(yùn)算資源，并充分運(yùn)用了CPLD編程的靈活性。實(shí)驗(yàn)結(jié)果表明，該電動(dòng)舵機(jī)控制系統(tǒng)運(yùn)行可靠、穩(wěn)定，具有較強(qiáng)的實(shí)用性。

發(fā)表于：7/23/2015

帶殘余補(bǔ)償?shù)耐馔茮_激響應(yīng)低成本FIR濾波器實(shí)現(xiàn)

基于帶殘余補(bǔ)償?shù)耐馔茮_激響應(yīng)設(shè)計(jì)技術(shù)，利用硬件描述語言編程在集成電路上對FIR數(shù)字濾波器進(jìn)行了綜合。該技術(shù)利用沖激響應(yīng)的準(zhǔn)周期特性近似濾波器系數(shù)，有效降低了FIR濾波器常系數(shù)乘法的復(fù)雜度，并通過殘余補(bǔ)償降低濾波器階數(shù)，同時(shí)應(yīng)用子項(xiàng)共享技術(shù)進(jìn)一步減少加法器個(gè)數(shù)。綜合結(jié)果表明所提方法可以有效節(jié)省高階FIR濾波器硬件資源的消耗，適用于低成本數(shù)字系統(tǒng)設(shè)計(jì)。

發(fā)表于：7/21/2015

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