| EMD 10G線路接口卡的硬件設(shè)計(jì)與實(shí)現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：249 K | |
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| 文檔介紹：針對(duì)現(xiàn)有網(wǎng)絡(luò)接入設(shè)備難以滿足流媒體等新業(yè)務(wù)要求的問題，深入研究了EMD（擴(kuò)展用分復(fù)用單元）10G線路接口卡的功能與結(jié)構(gòu)，并針對(duì)上行數(shù)據(jù)流的合路問題提出了基于FPGA的WDRR（加權(quán)欠賬輪詢）算法，該算法在不過度改變計(jì)算復(fù)雜度的情況下，使得時(shí)延性能得到改善；針對(duì)超寬表項(xiàng)的1 920位組播查表問題，提出了FPGA+TCAM+2*SRAM的組播流水線查表，與傳統(tǒng)的查表方案相比，其效率提高了67%。最后通過仿真，測試表明該硬件設(shè)計(jì)方案能夠滿足ACR路由器對(duì)EMD 10G線路接口卡的要求。 | |
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