| 基于FPGA的等精度頻率計(jì)IP Core設(shè)計(jì) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：250 K | |
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| 文檔介紹：介紹了等精度頻率測(cè)量方法的原理及誤差分析，利用基于FPGA的SoPC技術(shù)在QuartusⅡ5.0環(huán)境下用VHDL語(yǔ)言實(shí)現(xiàn)了等精度頻率計(jì)的軟核IP Core設(shè)計(jì)，并在相應(yīng)的開(kāi)發(fā)平臺(tái)上作了驗(yàn)證。 | |
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