| 基于最佳接收的UART的設(shè)計與實現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大?。?span>2073 K | |
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| 文檔介紹：針對通用異步接收和發(fā)送器UART對隨機(jī)脈沖干擾特別敏感的弱點，引入數(shù)字相關(guān)器，以實現(xiàn)信號的最佳接收及提高UART的抗干擾性能；結(jié)合現(xiàn)場可編程邏輯門陣列FPGA的結(jié)構(gòu)特點針對同步模塊和數(shù)字相關(guān)器等關(guān)鍵部件進(jìn)行邏輯設(shè)計優(yōu)化，使UART性能大為提高。 | |
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