基于FPGA的E1/VC-4數字復接器的設計與實現
所屬分類：技術論文
上傳者：aet
文檔大小：305 K
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文檔介紹：在分析同步數字體系中2.048Mbps支路信號E1異步映射復用進VC-4的過程的基礎上，對系統中各功能模塊的設計原理進行了詳細闡述，重點討論了時鐘/使能信號產生電路的功能及設計。最后，完成了E1/VC-4復接電路的設計與實現，并基于ALTERA/EP1C6T144C8環境完成了驗證。
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