| 用Verilog HDL實現(xiàn)I2C總線功能 | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：215 K | |
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| 文檔介紹：簡述了I2C總線的特點;介紹了開發(fā)FPGA時I2C總線模塊的設(shè)計思路;給出并解釋了用Verilog HDL實現(xiàn)部分I2C總線功能的程序,以及I2C總線主從模式下的仿真時序圖。 | |
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