| 基于DSP Builder的偽隨機(jī)序列發(fā)生器設(shè)計(jì)及FPGA實(shí)現(xiàn) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：323 K | |
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| 文檔介紹：簡要分析了偽隨機(jī)序列中應(yīng)用廣泛的m序列Gold序列及平衡Gold碼的概念"原理和應(yīng)用.提出了一種基于Altera 的DSP Builder工具箱的偽隨機(jī)序列產(chǎn)生器設(shè)計(jì)方法,并通過設(shè)計(jì)實(shí)例,說明這種方法在簡化設(shè)計(jì)難度,提高設(shè)計(jì)速度和靈活性等方面的優(yōu)點(diǎn)和應(yīng)用價(jià)值$ 并提出了其仿真和FPGA實(shí)現(xiàn)的基本方法. | |
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