異步FIFO控制器的設計
所屬分類：參考設計
上傳者：aet
文檔大?。?span>381 K
標簽： SoPC
所需積分：0分積分不夠怎么辦？
文檔介紹：異步FIFO是一種先進先出電路，可以有效解決異步時鐘之間的數據傳遞。通過分析異步FIFO設計中的難點，以降低電路中亞穩態出現的概率為主要目的，提出了一種格雷碼計數器的技術，通過仿真驗證，有效地實現了異步FIFO控制器的設計。該設計將大大提高工作頻率和資源利用率。
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