《電子技術應用》
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低電壓差分信號長線傳輸的優(yōu)化設計
2020年電子技術應用第11期
陳曉敏1,薛志超2,張志龍2,文 豐1,袁小康1
1.中北大學 電子測試技術國家重點實驗室,山西 太原030051; 2.中國運載火箭技術研究院空間物理重點實驗室,北京100076
摘要: 針對影響信號完整性的噪聲與衰減進行分析與驗證,硬件物理層采取預加重與均衡處理技術、同時進行阻抗匹配優(yōu)化并設計雙重電氣隔離,提升信號傳輸質量。軟件鏈路層進行兩級乒乓形式緩存設計以優(yōu)化傳輸效率;改進基于CRC校驗的反饋重傳機制,保證系統(tǒng)實現數據檢錯重傳功能,能適應更多鏈路異常情況。經驗證,優(yōu)化后在傳輸長度為100 m時系統(tǒng)可滿足180 Mb/s的高可靠傳輸,滿足工程應用技術要求。
中圖分類號: TN914
文獻標識碼: A
DOI:10.16157/j.issn.0258-7998.200521
中文引用格式: 陳曉敏,薛志超,張志龍,等. 低電壓差分信號長線傳輸的優(yōu)化設計[J].電子技術應用,2020,46(11):104-108.
英文引用格式: Chen Xiaomin,Xue Zhichao,Zhang Zhilong,et al. Optimal design of long-line transmission with low voltage differential signal[J]. Application of Electronic Technique,2020,46(11):104-108.
Optimal design of long-line transmission with low voltage differential signal
Chen Xiaomin1,Xue Zhichao2,Zhang Zhilong2,Weng Feng1,Yuan Xiaokang1
1.National Key Laboratory for Electronic Measurement Technology,North University of China,Taiyuan 030051,China; 2.Key Laboratory of Space Physics, China Academy of Launch Vehicle Technology,Beijing 100076,China
Abstract: The noise and attenuation that affect the signal integrity are analyzed and verified. The hardware physical layer adopts pre-emphasis and equalization processing technology. The impedance matching optimization and double electrical isolation are designed to improve the signal transmission quality. At the software link layer, a two-level ping-pong buffer is designed to optimize transmission efficiency. The feedback retransmission mechanism based on cyclic redundancy check is improved to ensure that the system realizes the function of data error detection and retransmission, and can adapt to more abnormal link conditions.It has been verified that when the optimized transmission length is 100 m, the system can achieve a high reliable transmission of 180 Mb/s, which meets the technical requirements of engineering applications.
Key words : low voltage differential signal;signal integrity;pre-emphasis;ping-pong;feedback retransmission mechanism

0 引言

    在實際工程試驗環(huán)境中,飛行器的多種傳感器及圖像數據需要通過穿艙差分電纜傳輸至地面測控臺[1],因此對于數據在穿艙差分電纜中的傳輸長度、可靠性有很高要求。基于以上應用場合,對低電壓差分信號傳輸鏈路硬件物理層與軟件鏈路層分別做優(yōu)化設計,所有設計模塊及信息處理均在FPGA平臺上實現,FPGA在單時鐘周期可執(zhí)行多個任務,與單片機相比FPGA對數據響應與處理速度更快,在高速數據處理方面有很大優(yōu)勢[2]




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作者信息:

陳曉敏1,薛志超2,張志龍2,文  豐1,袁小康1

(1.中北大學 電子測試技術國家重點實驗室,山西 太原030051;

2.中國運載火箭技術研究院空間物理重點實驗室,北京100076)

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