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銀湖資本完成對(duì)Altera的51%股權(quán)收購

銀湖資本完成對(duì)Altera的51%股權(quán)收購

北京時(shí)間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對(duì) Altera 51% 股權(quán)的收購，該股權(quán)原由英特爾公司持有。同時(shí)，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對(duì) Altera 未來良好發(fā)展充滿信心。

基于FPGA的數(shù)字分頻器設(shè)計(jì)

摘要：在設(shè)計(jì)數(shù)字電路過程中，通常所需的頻率要根據(jù)給定的頻率進(jìn)行分頻來得到。時(shí)鐘分頻又分為整數(shù)分頻和小數(shù)分頻，有時(shí)還有會(huì)有分?jǐn)?shù)分頻。當(dāng)基準(zhǔn)時(shí)鐘與所需的頻率成整數(shù)倍關(guān)系時(shí)為整數(shù)分頻，可以采用標(biāo)準(zhǔn)的計(jì)數(shù)器實(shí)現(xiàn)，也可以采用可編程邏輯器件實(shí)現(xiàn)。

發(fā)表于：9/4/2017

智原推出完整的FPGA轉(zhuǎn)換ASIC方案

ASIC設(shè)計(jì)服務(wù)暨IP研發(fā)銷售廠商智原科技今日宣布提供將FPGA設(shè)計(jì)轉(zhuǎn)換為ASIC芯片的完整方案，為客戶降低整體系統(tǒng)成本及功耗、縮小芯片尺寸，并維持長(zhǎng)期穩(wěn)定供貨，避免FPGA停產(chǎn)的風(fēng)險(xiǎn)。透過這套轉(zhuǎn)換FPGA設(shè)計(jì)的服務(wù)，智原已成功完成多種不同應(yīng)用的項(xiàng)目，將工業(yè)用馬達(dá)控制、電子水表、電子告示牌、POS收銀系統(tǒng)，與便攜式醫(yī)療設(shè)備等FPGA設(shè)計(jì)轉(zhuǎn)換成對(duì)效能與成本具有高度競(jìng)爭(zhēng)力的ASIC芯片。

發(fā)表于：8/31/2017

Sigmoid函數(shù)的分段非線性擬合法及其FPGA實(shí)現(xiàn)

使用分段非線性逼近算法計(jì)算超越函數(shù)，以神經(jīng)網(wǎng)絡(luò)中應(yīng)用最為廣泛的Sigmoid函數(shù)為例，結(jié)合函數(shù)自身對(duì)稱的性質(zhì)及其導(dǎo)數(shù)不均勻的特點(diǎn)提出合理的分段方法，給出分段方式同逼近多項(xiàng)式階數(shù)對(duì)逼近結(jié)果精度的影響。完成算法在FPGA上的硬件實(shí)現(xiàn)，給出一種使用三階多項(xiàng)式處理Sigmoid函數(shù)的擬合結(jié)果及流水線架構(gòu)，處理精度達(dá)到10-5數(shù)量級(jí)，最大頻率達(dá)到127.327 MHz，滿足了高速、高精度的處理要求。

發(fā)表于：8/30/2017

英特爾FPGA作為核心芯片

軟件業(yè)者為了強(qiáng)化人工智能算法的執(zhí)行效率，紛紛跨足硬件設(shè)計(jì)。繼Google、Facebook之后，微軟(Microsoft)近日也發(fā)表了自家的Project Brainwave平臺(tái)。該平臺(tái)以英特爾(Intel)提供的Stratix 10現(xiàn)場(chǎng)可編程門陣列(FPGA)為基礎(chǔ)，除了內(nèi)建深度神經(jīng)網(wǎng)絡(luò)(DNN)加速引擎外，在軟件堆棧方面，還可支持Google的Tensorflow、微軟自家的Cognitive Toolkit等深度學(xué)習(xí)框架。

發(fā)表于：8/27/2017

FPGA在AI中扮演的角色比預(yù)期還要大

摩根士丹利發(fā)表研究報(bào)告指出，F(xiàn)PGA在機(jī)器學(xué)習(xí)進(jìn)行「推論」(inference)時(shí)扮演的角色，可能比市場(chǎng)想象還要大， Xilinx有望受惠。

發(fā)表于：8/26/2017

百度發(fā)布XPU：AI云計(jì)算加速芯片（基于FPGA，256核心）

在加州Hot Chips大會(huì)上，百度發(fā)布XPU，這是一款256核、基于FPGA的云計(jì)算加速芯片。合作伙伴是賽思靈（Xilinx）。百度也在這次的大會(huì)上，透露了關(guān)于這款芯片的更多架構(gòu)方面的細(xì)節(jié)。

發(fā)表于：8/24/2017

基于FPGA的免疫層析信號(hào)數(shù)據(jù)采集系統(tǒng)

提出了一種基于FPGA控制的免疫層析信號(hào)數(shù)據(jù)采集系統(tǒng)，系統(tǒng)由免疫層析模擬信號(hào)采集模塊、FPGA數(shù)字控制模塊和上位機(jī)處理模塊組成。FPGA數(shù)字控制模塊由A/D驅(qū)動(dòng)、電機(jī)驅(qū)動(dòng)和數(shù)據(jù)傳輸模塊組成，其主要工作流程是電機(jī)轉(zhuǎn)動(dòng)的同時(shí)控制TM7705同步采樣，并在RAM中緩存采樣數(shù)據(jù)。該系統(tǒng)能夠?qū)崿F(xiàn)試條檢測(cè)的控制，檢測(cè)結(jié)果表示線性度為R2=0.998，靈敏度為0.027 7 mL/μg，最低檢測(cè)濃度為1.95 μg/mL，重復(fù)性小于5%。該系統(tǒng)檢測(cè)靈敏度較高、一致性穩(wěn)定，具有較好的實(shí)用性和可擴(kuò)展性。

發(fā)表于：8/10/2017

貿(mào)澤供貨基于Intel Cyclone V FPGA 的Terasic DE10-Nano套件

2017年8月8日 – 專注于新產(chǎn)品引入 (NPI) 與推動(dòng)創(chuàng)新的領(lǐng)先分銷商貿(mào)澤電子 (Mouser Electronics) 宣布即日起備貨Terasic Technologies的DE10-Nano開發(fā)套件。DE10-Nano 套件為Intel® FPGA 設(shè)計(jì)解決方案網(wǎng)絡(luò)的鉑金成員，是基于Intel片上系統(tǒng) (SoC) FPGA的強(qiáng)大硬件設(shè)計(jì)平臺(tái)，在用戶可定制的器件中同時(shí)集成了處理器、多個(gè)外設(shè)和FPGA體系結(jié)構(gòu)。

發(fā)表于：8/8/2017

多通道GNSS數(shù)據(jù)采集平臺(tái)的設(shè)計(jì)與實(shí)現(xiàn)

隨著GNSS系統(tǒng)的發(fā)展，多徑效應(yīng)逐漸成為影響定位精度和可靠性的重要因素之一。為了驗(yàn)證天線陣列方法對(duì)于多徑效應(yīng)的消除情況，需要對(duì)多個(gè)天線接收到的數(shù)據(jù)進(jìn)行實(shí)時(shí)同步采集存儲(chǔ)。為了實(shí)現(xiàn)這一目標(biāo)，利用基于PCIE通信總線的FPGA開發(fā)板與多路AD采集卡設(shè)計(jì)并實(shí)現(xiàn)了滿足系統(tǒng)要求的數(shù)據(jù)采集平臺(tái)。首先簡(jiǎn)要介紹了該采集平臺(tái)的結(jié)構(gòu)及PCIE通信鏈路的搭建，然后設(shè)計(jì)實(shí)現(xiàn)了一種數(shù)據(jù)連續(xù)存儲(chǔ)的方法，最后通過實(shí)驗(yàn)驗(yàn)證了該方法的可行性及采集平臺(tái)的整體性能。

發(fā)表于：8/4/2017

基于System Generator模型導(dǎo)出法的Boost變換器控制

利用System Generator軟件平臺(tái)，實(shí)現(xiàn)基于模塊化建模方法的變換器建模，并簡(jiǎn)化語言編寫控制系統(tǒng)的復(fù)雜過程。研究了從MATLAB-Xilinx環(huán)境中導(dǎo)出使用模塊化建模方法搭建的控制算法。通過MATLAB仿真、軟硬件聯(lián)合仿真和實(shí)驗(yàn)進(jìn)行驗(yàn)證，證明了將控制算法導(dǎo)出使用的可行性。

發(fā)表于：8/4/2017

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