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銀湖資本完成對Altera的51%股權(quán)收購

銀湖資本完成對Altera的51%股權(quán)收購

北京時間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對 Altera 51% 股權(quán)的收購，該股權(quán)原由英特爾公司持有。同時，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對 Altera 未來良好發(fā)展充滿信心。

美高森美宣布業(yè)界最低功率SmartFusion2 SoC和IGLOO2 FPGA獲得PCI Express 2.0 SIG認(rèn)證

致力于提供功率、安全、可靠與高性能半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司(Microsemi Corporation，紐約納斯達(dá)克交易所代號：MSCC)宣布SmartFusion®2 SoC FPGA和IGLOO®2 FPGA已經(jīng)獲得PCI® Express (PCIe) 2.0端點(diǎn)(endpoint)規(guī)范認(rèn)證，并且現(xiàn)已包含在PCI SIG 整合組件廠商名單(Integrators List)中。

發(fā)表于：12/16/2013

賽靈思攜Ultrascale、Vivado、UltraFast，劍指160億美元目標(biāo)市場！

賽靈思于12月10宣布已提供有關(guān)Kintex中端和Virtex高端20nm UltraScale系列的詳細(xì)器件選型表、產(chǎn)品技術(shù)文檔、設(shè)計工具及方法支持。

發(fā)表于：12/13/2013

Xilinx將業(yè)界最大容量器件翻番達(dá)到440萬邏輯單元密度優(yōu)勢領(lǐng)先整整一代

All Programmable FPGA、SoC和3D IC的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX) ）今天發(fā)布擁有440萬個邏輯單元的創(chuàng)紀(jì)錄產(chǎn)品，其密度是業(yè)界最高密度產(chǎn)品Virtex®-7 2000T的兩倍以上，該器件使其成功在高端器件市場連續(xù)兩代保持領(lǐng)先優(yōu)勢，并為客戶提供了超越工藝節(jié)點(diǎn)的價值優(yōu)勢。作為賽靈思今天推出的All Programmable UltraScale?系列的最高端器件，Virtex® UltraScale VU440 3D IC將賽靈思的領(lǐng)先優(yōu)勢從28nm的2倍提升到20nm的4倍，其容量超出任何其他可編程器件。VU440采用先進(jìn)的3D IC技術(shù)，在20nm工藝節(jié)點(diǎn)上的容量已經(jīng)超出了此前公開發(fā)布的所有競爭性14/16nm工藝計劃。

發(fā)表于：12/12/2013

Xilinx推出擁有ASIC級架構(gòu)和ASIC增強(qiáng)型設(shè)計方案的20nm All Programmable UltraScale產(chǎn)品

All Programmable FPGA、SoC和3D IC的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX) ）今天宣布推出其20nm All Programmable UltraScale?產(chǎn)品系列，并提供相關(guān)產(chǎn)品技術(shù)文檔和Vivado®設(shè)計套件支持。繼2013年11月初發(fā)貨業(yè)界首款20nm芯片后，賽靈思繼續(xù)積極推動其UltraScale器件的發(fā)貨進(jìn)程。這些器件采用業(yè)界唯一的ASIC級可編程架構(gòu)以及Vivado ASIC增強(qiáng)型設(shè)計套件和UltraFast?設(shè)計方法，可提供媲美ASIC級的性能優(yōu)勢。

發(fā)表于：12/12/2013

基于PSoC的滾刀周節(jié)誤差自動測量裝置

主要研究了基于可編程片上系統(tǒng)（PSoC）的滾刀周節(jié)誤差自動測量裝置，詳細(xì)論述了該裝置的自動測量原理與PSoC測量系統(tǒng)的組成。采用PSoC作為處理核心，半橋式自感傳感器作為誤差測量傳感器，由集成信號變送電路實(shí)現(xiàn)電感傳感器信號的調(diào)制與解調(diào)，采用PSoC自帶的高精度A/D轉(zhuǎn)換器對位移信號進(jìn)行采樣，經(jīng)過運(yùn)算后得到測量結(jié)果，實(shí)現(xiàn)了對滾刀周節(jié)誤差的自動精密測量。

發(fā)表于：12/9/2013

Altera的Arria 10版Quartus II軟件為立即開始20 nm設(shè)計提供支持

Altera公司(Nasdaq: ALTR)今天發(fā)布了Arria 10版Quartus II軟件，這是業(yè)界第一款支持20 nm FPGA和SoC的開發(fā)工具。基于TSMC 20 nm工藝技術(shù)，Arria 10 FPGA和SoC性能比目前的高端FPGA高出15%，功耗比以前的中端器件低40%，重塑了中端FPGA和SoC。客戶現(xiàn)在可以在熟悉而且成熟的Quartus II設(shè)計環(huán)境中，開始開發(fā)基于Arria 10 FPGA和SoC的系統(tǒng)，而且其編譯時間是業(yè)界最短的。

發(fā)表于：12/3/2013

Synopsys全新超低功耗非揮發(fā)性存儲器IP在將功耗降低90%的同時面積縮小一半

為加速芯片和電子系統(tǒng)創(chuàng)新而提供軟件、知識產(chǎn)權(quán)（IP）及服務(wù)的全球性領(lǐng)先供應(yīng)商新思科技公司（Synopsys,Inc.，納斯達(dá)克股票市場代碼：SNPS）日前宣布：其專為功耗和面積要求嚴(yán)格的無線應(yīng)用和RFID/NFC集成電路而進(jìn)行了優(yōu)化的DesignWare® AEON®多次可編程（MTP）超低功耗（ULP）非易失性存儲器（NVM）IP開始供貨。與上一代產(chǎn)品相比，通過提供一種單比特位讀取功能、低至0.9V的讀取操作以及擦寫操作中低于10uA的峰值電流DesignWare AEON MTP ULP NVM IP將功耗降低了90%。降低功耗在移動系統(tǒng)中意味著延長電池的壽命，提高RFID/NFC標(biāo)簽的靈敏度，并允許更小的天線從而減小了標(biāo)簽的尺寸。

發(fā)表于：12/3/2013

基于CPCI總線的PMC載板設(shè)計

設(shè)計了一種基于CPCI總線標(biāo)準(zhǔn)的PMC接口載板。載板以FPGA為核心，集成了CPCI接口模塊和DPRAM（雙口RAM）模塊，CPCI接口模塊采用FPGA+PCI IP核（軟核）解決了系統(tǒng)集成的問題，DPRAM模塊為系統(tǒng)提供了數(shù)據(jù)緩存功能。環(huán)回測試和中斷測試解決了在沒有子卡PMC模塊的情況下，讀寫、驗證DPRAM空間數(shù)據(jù)和測試中斷響應(yīng)的問題。此外，還支持子卡PMC模塊后出線到CPCI總線。調(diào)試結(jié)果表明，該載板在嵌入式實(shí)時操作系統(tǒng)VxWorks下可以穩(wěn)定運(yùn)行，正確地讀寫DPRAM空間的數(shù)據(jù)，及時地響應(yīng)中斷，滿足了對載板的性能需求。

發(fā)表于：11/29/2013

基于AMBA APB總線的Nand Flash控制器的設(shè)計

介紹了基于AMBA APB總線Nand Flash控制器的設(shè)計，首先簡單介紹了 Nand Flash的一些特點(diǎn)，然后詳細(xì)介紹了Nand Flash 控制器的整體框架、具體功能及其內(nèi)部的數(shù)據(jù)通路。該控制器通過ModelSim進(jìn)行了仿真及FPGA板級驗證，結(jié)果證明能夠滿足Nand Flash時序要求。

發(fā)表于：11/29/2013

Altera在SPS IPC驅(qū)動2013大會上展示單芯片實(shí)現(xiàn)的集成PLC和HMI系統(tǒng)

Altera公司(NASDAQ: ALTR)今天宣布，在德國紐倫堡舉行的SPS IPC驅(qū)動2013大會上展示自動化系統(tǒng)設(shè)計的一項關(guān)鍵開發(fā)——在一個芯片上實(shí)現(xiàn)可編程邏輯控制器(PLC)和人機(jī)接口(HMI)系統(tǒng)。Altera在單片28 nm Altera Cyclone® V SoC上實(shí)現(xiàn)了集成PLC/HMI系統(tǒng)，將于2014年以參考設(shè)計的形式提供該系統(tǒng)。

發(fā)表于：11/28/2013

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