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銀湖資本完成對Altera的51%股權收購

銀湖資本完成對Altera的51%股權收購

北京時間9月15日晚間，全球 FPGA 創(chuàng)新技術領導者 Altera 宣布，全球技術投資巨頭銀湖資本（Silver Lake）已完成對 Altera 51% 股權的收購，該股權原由英特爾公司持有。同時，英特爾將保留 Altera 49% 的股權，此舉也彰顯了雙方對 Altera 未來良好發(fā)展充滿信心。

我們破解了幾乎所有旗艦手機的人臉識別，iPhone幸免于難

你的手機到底能有多安全？今天市面上能買到的智能手機大多都用上了指紋識別和人臉識別，高端一點的兩種技術都有，除了解鎖手機之外，很多人也會拿這些技術用于支付。

發(fā)表于：12/17/2018

不使用先驗知識與復雜訓練策略，從頭訓練二值神經(jīng)網(wǎng)絡！

來自德國哈索普拉特納研究院 (Hasso Plattner Institute) 的研究者近日發(fā)布論文，介紹了他們提出的訓練二值神經(jīng)網(wǎng)絡新方法。

發(fā)表于：12/17/2018

RTX 2080時代，如何打造屬于自己的深度學習機器

深度學習是計算密集型的領域，搭建深度學習系統(tǒng)時，最糟糕的事情之一就是把錢浪費在并非必需的硬件上。

發(fā)表于：12/17/2018

【論文集錦】基于Xilinx FPGA的《電子技術應用》優(yōu)秀論文集錦

在2018年10月XDF北京站上，Xilinx又一次宣布調(diào)整產(chǎn)品的架構，從FPGA芯片廠商向平臺廠商轉(zhuǎn)型，并發(fā)布新的平臺——ACAP（Adaptive Compute Acceleration Platform，自適應計算加速平臺）以迎接數(shù)據(jù)中心、AI帶來的新機遇。小編整理了《電子技術應用》近來刊登的基于Xilinx FPGA的技術應用論文，歡迎相關領域研究者參考借鑒！

發(fā)表于：12/17/2018

多核DSP與FPGA高速數(shù)據(jù)傳輸系統(tǒng)設計與實現(xiàn)

針對嵌入式圖像處理系統(tǒng)中大數(shù)據(jù)量、高傳輸速度及和高實時運算性能的需求，提出一種以多核DSP TMS320C6678為核心的高速數(shù)據(jù)傳輸存儲系統(tǒng)，基于DSP高速串行Rapid IO(SRIO)模塊進行圖像數(shù)據(jù)高速傳輸，使用SRIO模塊的Direct I/O傳輸模式，采用4x接口模式配置，每路接口傳輸速率為3.125 Gb/s，理論傳輸速率為10 Gb/s，同時使用DDR3控制器模塊擴展存儲空間，實現(xiàn)光學及雷達圖像的共享存儲。通過實驗結果表明，設計的SRIO高速傳輸系統(tǒng)傳輸速度超過8 Gb/s，達到理論值的80%以上，滿足大數(shù)據(jù)高速傳輸需求，有效實現(xiàn)了多處理器之間的數(shù)據(jù)傳輸和共享存儲。

發(fā)表于：12/14/2018

Trinamic發(fā)布全新的StepRocker?家族成員

在當今的市場中，在最快的時間內(nèi)將想法轉(zhuǎn)化為有形產(chǎn)品是勢在必行的。有了信用卡尺寸大小的新TMCM-1211StepRocker?和TMCM-1316 StepRocker?伺服驅(qū)控板，您可以立即開發(fā)您的產(chǎn)品。

發(fā)表于：12/13/2018

西門子推出集成了人工智能芯片的全新模塊主要針對Simatic控制系統(tǒng)

西門子推出一款集成了人工智能（AI）芯片的全新模塊，用于Simatic S7-1500控制器和ET 200MP I/O系統(tǒng)。SimaTIc S7-1500 TM神經(jīng)處理器（NPU）使用英特爾Movidius Myriad X視覺處理器。

發(fā)表于：12/13/2018

【論文集錦】基于Intel FPGA的《電子技術應用》優(yōu)秀論文集錦

《電子技術應用》與從前的Altera、現(xiàn)在的Intel FPGA一直有良好的合作，刊登了許多基于Intel FPGA的技術應用論文，小編整理于此，歡迎相關領域研究者參考借鑒！

發(fā)表于：12/11/2018

這7大技術正影響您2019年的產(chǎn)品設計，工程師產(chǎn)品經(jīng)理必看！

深圳國際電子展ELEXCON2018暨嵌入式系統(tǒng)展將于12月20-22日在會展中心開幕！作為行業(yè)年度大秀，ELEXCON2018緊跟全球智能化、萬物互聯(lián)和新能源趨勢，將協(xié)同超過800家優(yōu)質(zhì)技術提供商，共同展示從AI人工智能、物聯(lián)網(wǎng)到智能駕駛等最新市場的核心技術及解決方案。

發(fā)表于：12/11/2018

基于FPGA的SCL譯碼算法優(yōu)化與設計

由于極化碼被指出在二進制離散無記憶信道中具有實現(xiàn)其極限容量的理論性能，近年來極化碼在通信領域的貢獻日漸凸顯。極化碼的譯碼系統(tǒng)可采用軟件或者硬件方式實現(xiàn)，其中使用軟件方式時譯碼效率受限于CPU的串行處理模式，因此在具有并行工作模式的FPGA上進行極化碼的譯碼實現(xiàn)對于通信系統(tǒng)來說具有非常大的意義。首先介紹了極化碼的SCL譯碼算法；然后針對該算法進行優(yōu)化從而提高譯碼效率，以及針對該算法在FPGA上的實現(xiàn)進行了定點量化的改進；最后對譯碼器進行硬件仿真，以及在FPGA上進行了實現(xiàn)與性能分析。實驗結果表明該譯碼器在碼長為512時譯碼最高頻率為143.988 MHz，吞吐率為28.79 Mb/s。

發(fā)表于：12/7/2018

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