| 全數(shù)字鎖相環(huán)的設(shè)計(jì) | |
| 所屬分類：參考設(shè)計(jì) | |
| 上傳者：sidney | |
| 文檔大小：103 K | |
| 標(biāo)簽： FPGA | |
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| 文檔介紹：在說明全數(shù)字鎖相環(huán)的基礎(chǔ)上，提出了一種利用FPGA設(shè)計(jì)一階全數(shù)字鎖相環(huán)的方法，并給出了關(guān)鍵部件的RTL可綜合代碼，并結(jié)合本設(shè)計(jì)的一些仿真波形詳細(xì)描述了數(shù)字鎖相環(huán)的工作過程，最后對一些有關(guān)的問題進(jìn)行了討論。 | |
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