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銀湖資本完成對Altera的51%股權(quán)收購

銀湖資本完成對Altera的51%股權(quán)收購

北京時間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對 Altera 51% 股權(quán)的收購，該股權(quán)原由英特爾公司持有。同時，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對 Altera 未來良好發(fā)展充滿信心。

基于輪廓PCA的字母手勢識別算法研究

提出了一種改進的手勢檢測識別算法。首先對采集的手勢圖像綜合運用Krisch算子的背景差分與膚色分割等算法進行預(yù)處理，然后根據(jù)手勢的方向去除胳膊等非目標，截取手型區(qū)域。最后對手型圖像進行輪廓檢測，根據(jù)手型輪廓的二值圖像進行PCA降維，并與投影降維后的樣本計算空間距離，從而進行手勢分類。通過此方法可以快速、準確地檢測到手型區(qū)域，識別手型含義，且具有實時性。

發(fā)表于：10/14/2015

2×4 MIMO-OFDM系統(tǒng)中 K-Best檢測器的設(shè)計與實現(xiàn)

基于貝爾實驗室V-BLAST結(jié)構(gòu)構(gòu)建了2×4 MIMO-OFDM系統(tǒng)模型，并確定了該模型下K-Best算法的K值。之后對K-Best檢測器進行了硬件架構(gòu)設(shè)計，采用Xilinx Virtex-5芯片對所設(shè)計檢測器加以實現(xiàn)，并給出檢測器資源消耗和時鐘頻率等性能指標，最后通過仿真驗證檢測器正確性。

發(fā)表于：10/12/2015

歐盟將無條件批準英特爾收購Altera

路透社今日援引兩位知情人士的消息稱，歐盟很快將無條件批準英特爾收購Altera交易。英特爾今年6月1日宣布，將以約167億美元的現(xiàn)金收購可編程邏輯芯片巨頭Altera。英特爾此舉旨在強化公司的數(shù)據(jù)中心芯片業(yè)務(wù)，開發(fā)用于汽車、智能手表和其他“物聯(lián)網(wǎng)”設(shè)備芯片。

發(fā)表于：10/12/2015

全新VersaClock 6可編程時鐘發(fā)生器能夠提供屢獲殊榮的IDT VersaClock 系列產(chǎn)品的最佳的性能

美國加利福尼亞州圣何塞，2015年10月9日 - IDT公司（IDT®）（NASDAQ：IDTI）今天宣布推出VersaClock®6可編程時鐘發(fā)生器系列，能夠針對要求苛刻的高性能應(yīng)用提供高靈活性和低功耗的時序解決方案。VersaClock®6系列產(chǎn)品具有低于500飛秒（fs）的RMS（均方根）相位抖動，能夠提供屢獲殊榮的IDT VersaClock 系列產(chǎn)品目前最佳的性能，實現(xiàn)了抖動性能、靈活性和低工作功耗的出眾組合。

發(fā)表于：10/11/2015

基于FPGA和DSPIC30F6014A的數(shù)據(jù)記錄器設(shè)計

針對目前飛行數(shù)據(jù)記錄器對數(shù)據(jù)的大容量和高速存儲的需求，提出了一種以DSPIC30F6014A控制USB接口芯片CH378讀寫U盤數(shù)據(jù)，并添加FPGA控制讀寫大容量Flash數(shù)據(jù)作為高速數(shù)據(jù)緩沖以實現(xiàn)脫離計算機存儲高速大容量數(shù)據(jù)至U盤的設(shè)計方案。該方案能夠?qū)崿F(xiàn)大容量數(shù)據(jù)存儲功能，并能夠極大地提高U盤讀寫數(shù)據(jù)的速度，具有設(shè)備體積小、成本低和便于攜帶等優(yōu)點，很大程度緩解了數(shù)據(jù)存儲的壓力，具有很廣闊的應(yīng)用前景。

發(fā)表于：10/11/2015

基于FPGA高速圖像數(shù)據(jù)的存儲及顯示設(shè)計

設(shè)計了一種基于FPGA控制Nand Flash陣列實現(xiàn)高速流水線式存儲的方案。設(shè)計利用FPGA作為主控制器，通過CameraLink輸入通信接口將圖像數(shù)據(jù)經(jīng)過一/二級緩存寫入Flash存儲陣列中，并采用DMA傳輸技術(shù)將存儲后的圖像數(shù)據(jù)上傳至計算機硬盤中作進一步處理；同時，利用SDRAM顯存實時刷新數(shù)據(jù)，F(xiàn)PGA構(gòu)造相應(yīng)的VGA信號，最終實現(xiàn)100 MB/s圖像數(shù)據(jù)的實時顯示。

發(fā)表于：10/11/2015

一種抑制電路溫度漂移影響的高溫測量系統(tǒng)

設(shè)計了一種耐155 ℃高溫的井下測量系統(tǒng)，為了滿足多通道信號的測量，其前置放大電路采用分時復(fù)用的工作機制，刻度信號與目標信號通過模擬開關(guān)分時送至前置放大器。發(fā)射電流經(jīng)取樣后得到參考信號，運用數(shù)字相敏檢波算法計算其幅度和相位，為分時導(dǎo)通的刻度信號和目標信號提供相位基準。通過對模擬通道進行實時的刻度，確保測量結(jié)果不隨電路的溫度漂移而發(fā)生變化。實驗結(jié)果表明，該方法能有效地抑制溫漂對測量系統(tǒng)的影響。

發(fā)表于：10/11/2015

基于ARM+FPGA的引信信息測試系統(tǒng)設(shè)計與實現(xiàn)

引信信息交聯(lián)信號具有快速性、瞬時性和高頻率等特性。通過嵌入式系統(tǒng)和FPGA設(shè)計實現(xiàn)了一種引信信息交聯(lián)信號的測試系統(tǒng)，能同時對多路引信交聯(lián)信息進行實時檢測、信息發(fā)送裝定和反饋，通過對高頻瞬時信號的信息處理，設(shè)計專用調(diào)制解調(diào)與編碼解碼電路和人機交互應(yīng)用程序。設(shè)計的測試系統(tǒng)經(jīng)過多次試驗，驗證了其有效性和準確性。

發(fā)表于：10/9/2015

Xilinx多重處理系統(tǒng)芯片提前出貨

賽靈思(Xilinx)宣布提早一季為首位客戶出貨業(yè)界首款16nm多重處理系統(tǒng)晶片(MPSoC)。早期版本的Zynq UltraScale+ MPSoC讓賽靈思客戶能夠開始設(shè)計及提供基于MPSoC的系統(tǒng)。

發(fā)表于：10/9/2015

一種新型圖像壓縮系統(tǒng)的設(shè)計

為打破傳統(tǒng)的攝像機-采集卡-存儲卡為一體的簡單采集存儲設(shè)計模式，實現(xiàn)模擬視頻和數(shù)字視頻雙采集及數(shù)據(jù)壓縮、高速傳輸?shù)男履Ｊ剑O(shè)計了一種以FPGA為控制核心、DSP為圖像數(shù)據(jù)處理中心、IP核的生成與雙SDRAM乒乓緩存協(xié)同工作為技巧、PCI卡高速傳輸為手段的圖像壓縮系統(tǒng)。DSP邏輯編碼的改進使圖像壓縮比得到進一步提高。通過實際測試，圖像的壓縮比可達26:1；FPGA+DSP+PCI卡的綜合使用使處理圖像數(shù)據(jù)的速度提高至少50％，圖像轉(zhuǎn)存速率更是達到了38 MB/s。

發(fā)表于：10/8/2015

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