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銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

北京時(shí)間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對(duì) Altera 51% 股權(quán)的收購(gòu)，該股權(quán)原由英特爾公司持有。同時(shí)，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對(duì) Altera 未來良好發(fā)展充滿信心。

Altera推出Serial RapidIO IP內(nèi)核，保證下一代通信基礎(chǔ)設(shè)施的互操作性

Altera公司 (NASDAQ: ALTR)今天宣布，開始提供新的Serial RapidIO® Gen2 MegaCore®功能知識(shí)產(chǎn)權(quán)(IP)，滿足全球通信基礎(chǔ)設(shè)施系統(tǒng)日益增長(zhǎng)的帶寬需求。該IP新解決方案成功實(shí)現(xiàn)了所有硬件與最新Integrated Device Technology (IDT®)RapidIO芯片的互操作性，并支持28 nm Altera Stratix® V FPGA，每通路工作速率高達(dá)6.25 Gbaud。通過提前驗(yàn)證互操作性，Altera和IDT支持客戶采用RapidIO減少接口調(diào)試時(shí)間，而將重點(diǎn)放在系統(tǒng)設(shè)計(jì)的核心功能上。

發(fā)表于：11/1/2012

Altera率先在28 nm FPGA上測(cè)試復(fù)數(shù)高性能浮點(diǎn)數(shù)字信號(hào)處理設(shè)計(jì)

Altera公司(NASDAQ: ALTR)今天宣布，在業(yè)界率先在28 nm FPGA器件上成功測(cè)試了復(fù)數(shù)高性能浮點(diǎn)數(shù)字信號(hào)處理(DSP)設(shè)計(jì)。獨(dú)立技術(shù)分析公司Berkeley設(shè)計(jì)技術(shù)有限公司(BDTI)驗(yàn)證了能夠在Altera Stratix® V和Arria® V 28 nm FPGA開發(fā)套件上簡(jiǎn)單方便的高效實(shí)現(xiàn)Altera浮點(diǎn)DSP設(shè)計(jì)流程，同時(shí)驗(yàn)證了要求較高的浮點(diǎn)DSP應(yīng)用的性能。

發(fā)表于：10/30/2012

基于FPGA的高精度超聲波測(cè)距系統(tǒng)的設(shè)計(jì)

設(shè)計(jì)了一種基于FPGA的超聲波測(cè)距模塊。在時(shí)序和信號(hào)處理方面，采用Cyclone II系列EP2C5T144C8芯片，通過設(shè)計(jì)時(shí)序發(fā)生器、高速計(jì)數(shù)、回波識(shí)別和可變門檻控制等邏輯電路模塊可快速有序地對(duì)信號(hào)進(jìn)行處理。在聲速方面，加入了溫度補(bǔ)償模塊，避免使用固定的聲速值所引入的偏差，從而提高系統(tǒng)精度。該系統(tǒng)具有可靠性高、集成度高和響應(yīng)速度快等特點(diǎn)，實(shí)驗(yàn)表明，在距障礙物600 mm~3 600 mm時(shí)，相對(duì)誤差在0.3%以內(nèi)，測(cè)量精度得到很大提高。

發(fā)表于：10/29/2012

內(nèi)嵌8051的USB 2.0設(shè)備控制器IP設(shè)計(jì)

基于USB 2.0協(xié)議規(guī)范提出了一個(gè)USB 2.0設(shè)備控制器串行接口引擎SIE的IP核的設(shè)計(jì)，并內(nèi)嵌8051軟核作為其微控制器進(jìn)行SoC設(shè)計(jì)。所設(shè)計(jì)的SIE核在FPGA開發(fā)板上經(jīng)過驗(yàn)證。

發(fā)表于：10/29/2012

基于嵌入式Linux的 TFT LCD IP及驅(qū)動(dòng)的設(shè)計(jì)

基于嵌入式Linux的 TFT LCD IP及驅(qū)動(dòng)的設(shè)計(jì),本文設(shè)計(jì)實(shí)現(xiàn)了一個(gè)簡(jiǎn)單的基于Avalon總線的TFT LCD控制器，能實(shí)現(xiàn)640×480，顏色深度為16bit的彩色圖形顯示，可應(yīng)用于各種TFT LCD，亦可改寫為VGA控制器，有較大的靈活性。

發(fā)表于：10/25/2012

賽靈思發(fā)布Vivado設(shè)計(jì)套件2012.3將生產(chǎn)力提升數(shù)倍

All Programmable技術(shù)和器件的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX) ）今天宣布推出Vivado?設(shè)計(jì)套件2012.3版本，首次為在多核處理器工作站上運(yùn)行該工具的客戶提供全新的增強(qiáng)功能，大幅提升生產(chǎn)力，同時(shí)，還為加速設(shè)計(jì)實(shí)現(xiàn)提供了全新的參考設(shè)計(jì)。

發(fā)表于：10/25/2012

借力ARM 64位V8 臺(tái)積電16nm FinFET藍(lán)圖仍霧里看花?

臺(tái)積電(TSMC)在日前的年度大會(huì)中，宣布制訂了20nm平面、16nmFinFET和2.5D發(fā)展藍(lán)圖。臺(tái)積電也將使用ARM的第一款64位處理器V8來測(cè)試16nmFinFET制程，并可望在未來一年內(nèi)推出首款測(cè)試芯片。臺(tái)積電與其合作伙伴們表示，用于

發(fā)表于：10/24/2012

萊迪思MachXO2控制開發(fā)套件適用于復(fù)雜系統(tǒng)控制和接口設(shè)計(jì)的樣機(jī)開發(fā)

萊迪思半導(dǎo)體公司（NASDAQ: LSCC）今日宣布推出MachXO2?系列超低密度FPGA控制開發(fā)套件，適用于低成本的復(fù)雜系統(tǒng)控制和視頻接口設(shè)計(jì)的樣機(jī)開發(fā)。新加入了MachXO2-4000HC器件，包括4320個(gè)查找表（LUT）的可編程邏輯和222 Kbit片上存儲(chǔ)器，滿足了通信、計(jì)算、工業(yè)、消費(fèi)電子和醫(yī)療市場(chǎng)所需的系統(tǒng)控制和接口應(yīng)用。

發(fā)表于：10/23/2012

意法半導(dǎo)體與Soitec攜手通過CMP提供28納米FD-SOI CMOS制程

意法半導(dǎo)體（STMicroelectronics，簡(jiǎn)稱ST；紐約證券交易所代碼：STM）、Soitec（歐洲證券交易所）與CMP(CircuitsMultiProjets®) 共同宣布，現(xiàn)在大學(xué)院校、研究實(shí)驗(yàn)室和設(shè)計(jì)企業(yè)可通過CMP的硅中介服務(wù)使用意法半導(dǎo)體的CMOS 28納米全耗盡型絕緣層上硅（FD-SOI）制程進(jìn)行工程流片，意法半導(dǎo)體的新制程采用Soitec公司開發(fā)的創(chuàng)新型硅襯底。隨著首批商用晶圓即將下線，意法半導(dǎo)體正在將這項(xiàng)制程下放給第三方芯片制造商。

發(fā)表于：10/23/2012

基于FPGA的圖像采集和快速移動(dòng)物體檢測(cè)

提出了一種圖像采集和快速移動(dòng)物體檢測(cè)的設(shè)計(jì)，即通過FPGA實(shí)現(xiàn)對(duì)攝像頭的初始化及數(shù)據(jù)采集，并通過自定義的傳輸協(xié)議將FPGA緩存中的數(shù)據(jù)傳輸給ARM7處理器，實(shí)現(xiàn)圖像數(shù)據(jù)的快速傳輸。根據(jù)適用范圍，本文提出了自適應(yīng)二值化閥值及相關(guān)的檢測(cè)算法改進(jìn)。這對(duì)于小型的、低功耗實(shí)用型的監(jiān)控系統(tǒng)具有一定的實(shí)用價(jià)值。

發(fā)表于：10/22/2012

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