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銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

銀湖資本完成對(duì)Altera的51%股權(quán)收購(gòu)

北京時(shí)間9月15日晚間，全球 FPGA 創(chuàng)新技術(shù)領(lǐng)導(dǎo)者 Altera 宣布，全球技術(shù)投資巨頭銀湖資本（Silver Lake）已完成對(duì) Altera 51% 股權(quán)的收購(gòu)，該股權(quán)原由英特爾公司持有。同時(shí)，英特爾將保留 Altera 49% 的股權(quán)，此舉也彰顯了雙方對(duì) Altera 未來(lái)良好發(fā)展充滿信心。

HDLC的FPGA實(shí)現(xiàn)方法

從HDLC的基本定義出發(fā)，通過(guò)對(duì)FPGA設(shè)計(jì)輸入的模塊化描述，介紹一種能夠在可編程邏輯芯片中實(shí)現(xiàn)HDLC功能的方法。

發(fā)表于：4/18/2012

FPGA技術(shù)在汽車電子中的應(yīng)用

FPGA技術(shù)帶來(lái)了汽車電子測(cè)試技術(shù)的創(chuàng)新，憑借開(kāi)發(fā)基于FPGA硬件的單個(gè)系統(tǒng)可以解決不同的汽車設(shè)計(jì)和測(cè)試應(yīng)用，而無(wú)需多個(gè)定制的測(cè)試設(shè)備。基于LabVIEW的圖形化FPGA編程則進(jìn)一步縮短了開(kāi)發(fā)時(shí)間。NI CompactRIO和基于PXI的可重復(fù)配置I/O模塊都是基于FPGA的硬件平臺(tái)，用戶不僅可以開(kāi)發(fā)適用于涉及汽車總線、不同信號(hào)類型的車載測(cè)試應(yīng)用，還可用于汽車ECU設(shè)計(jì)流程中的快速原型驗(yàn)證和硬件在環(huán)仿真測(cè)試。

發(fā)表于：4/18/2012

遠(yuǎn)程測(cè)控中嵌入式Web服務(wù)器的FPGA實(shí)現(xiàn)

本文將嵌入式系統(tǒng)與Internet技術(shù)相結(jié)合，在FPGA上開(kāi)發(fā)了一個(gè)嵌入式WEB服務(wù)器，并與電網(wǎng)參數(shù)測(cè)量?jī)x器相結(jié)合，構(gòu)成遠(yuǎn)程電網(wǎng)參數(shù)測(cè)量系統(tǒng)，為電網(wǎng)系統(tǒng)網(wǎng)絡(luò)化管理提供了技術(shù)支持，具有很好的應(yīng)用前景。

發(fā)表于：4/18/2012

采用多內(nèi)核無(wú)線虛擬系統(tǒng)原型的系統(tǒng)級(jí)調(diào)試

開(kāi)發(fā)一個(gè)復(fù)雜的多內(nèi)核無(wú)線系統(tǒng)無(wú)疑是個(gè)艱巨的挑戰(zhàn)，特別是當(dāng)內(nèi)核包含有高性能處理器和先進(jìn)的數(shù)字信號(hào)處理器(DSP) 時(shí)更是如此。等待硬件原型實(shí)現(xiàn)是不能令人接受的：關(guān)鍵的軟硬件折衷應(yīng)該在芯片制造之前盡早地完成。在內(nèi)核芯片制造前傳統(tǒng)的驗(yàn)證與調(diào)試方法依賴于指令集仿真器(ISS)模型。不幸的是，ISS模型速度太慢，并且時(shí)序精度無(wú)法達(dá)到與系統(tǒng)硬件部分的RTL模型交互所需的要求。

發(fā)表于：4/18/2012

邏輯分析儀SignalTaPⅡ在系統(tǒng)級(jí)調(diào)試中的應(yīng)用

邏輯分析儀SignalTaPⅡ在系統(tǒng)級(jí)調(diào)試中的應(yīng)用,摘要：嵌入式邏輯分析儀SignalTapII是QuartusII軟件中第二代系統(tǒng)級(jí)調(diào)試工具，它可以用來(lái)捕捉目標(biāo)芯片內(nèi)部信號(hào)節(jié)點(diǎn)處的信息，而又不影響原硬件系統(tǒng)的正常工作。通過(guò)一個(gè)多波形信號(hào)發(fā)生器的設(shè)計(jì)實(shí)例，詳細(xì)闡述Signal

發(fā)表于：4/18/2012

Altera任命Bradley Howe為研發(fā)資深副總裁

Altera公司(NASDAQ: ALTR)今天宣布，任命Bradley Howe為研發(fā)資深副總裁。對(duì)于這一職務(wù)，Howe先生全面負(fù)責(zé)Altera硅片產(chǎn)品、知識(shí)產(chǎn)權(quán)(IP)庫(kù)和軟件產(chǎn)品的開(kāi)發(fā)，并監(jiān)督公司全球研發(fā)組織。在此之前，Howe先生是Altera的IC設(shè)計(jì)副總裁。他直接向Altera總裁、CEO兼董事會(huì)主席John Daane負(fù)責(zé)。

發(fā)表于：4/18/2012

Cypress CY8CKIT－017開(kāi)發(fā)板CAN－LIN擴(kuò)展方案

Cypress公司的PSoC5系列具有獨(dú)特的可配置模塊陣列，是真正的系統(tǒng)級(jí)解決方案，能夠通過(guò)單個(gè)芯片提供MCU、存儲(chǔ)器、模擬和數(shù)字外設(shè)功能,提供了一種新型的信號(hào)采集、信號(hào)處理和控制方法，并具有高精度、高帶寬和高靈活性等特點(diǎn),廣泛應(yīng)用在眾多消費(fèi)、工業(yè)和醫(yī)學(xué)應(yīng)用領(lǐng)域.本文介紹了PSoC5主要特性,簡(jiǎn)化的框圖,ARM CortexM3框圖,時(shí)鐘子系統(tǒng)框圖,CAN控制器框圖以及CY8CKIT-017CAN/LIN擴(kuò)展板主要特性,框圖,電路圖,材料清單和PCB元

發(fā)表于：4/18/2012

DNLMS濾波器的FPGA實(shí)現(xiàn)

自適應(yīng)濾波器一直是信號(hào)處理領(lǐng)域的研究熱點(diǎn)之一，經(jīng)過(guò)多年的發(fā)展，已經(jīng)被廣泛應(yīng)用于數(shù)字通信、回聲消除、圖像處理等領(lǐng)域。自適應(yīng)濾波算法的研究始于20世紀(jì)50年代末，Widrow和Hoff等人最早提出最小均方算法(LMS)。算法由于結(jié)構(gòu)簡(jiǎn)單，計(jì)算量小，易于實(shí)時(shí)處理，因此在噪聲抵消，譜線增強(qiáng)，系統(tǒng)識(shí)別等方面得到了廣泛的應(yīng)用。為了克服定步長(zhǎng)LMS算法中收斂速度、收斂精度及跟蹤速度等對(duì)步長(zhǎng)大小選取相互矛盾的缺點(diǎn)，人們提出了許多變步長(zhǎng)LMS算法，但是，當(dāng)輸入信號(hào)具有強(qiáng)相關(guān)性時(shí)，例如語(yǔ)音信號(hào)，LMS算法及NLMS算法的收斂速度將急劇下降。因此，本文對(duì)進(jìn)入自適應(yīng)濾波器的輸入信號(hào)首先進(jìn)行解相關(guān)預(yù)處理，再對(duì)自適應(yīng)濾波器進(jìn)行歸一化LMS。

發(fā)表于：4/17/2012

在嵌入FPGA的IP核8051上實(shí)現(xiàn)TCP/IP的設(shè)計(jì)

介紹了如何將可綜合的IP核8051嵌入FPGA的基本方案, 著重討論了利用嵌入的IP核來(lái)實(shí)現(xiàn)簡(jiǎn)單的TCP/IP協(xié)議, 從而實(shí)現(xiàn)遠(yuǎn)程調(diào)試的具體方法。利用該方法不但能夠通過(guò)8051進(jìn)行某些簡(jiǎn)單的控制而不需要改變FPGA的程序, 而且還能通過(guò)8051實(shí)現(xiàn)TCP/IP對(duì)FPGA的遠(yuǎn)程調(diào)試。

發(fā)表于：4/17/2012

用FPGA實(shí)現(xiàn)WCDMA下行擾碼

本文介紹下行擾碼的生成過(guò)程和如何用FPGA的實(shí)現(xiàn)。采用Verlog硬件描述語(yǔ)言進(jìn)行功能描述，在寫信號(hào)的作用下，予付擾碼初值，在時(shí)鐘信號(hào)的作用下，產(chǎn)生下行擾碼的I，Q序列。

發(fā)表于：4/17/2012

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