基于Innovus的復(fù)雜時(shí)鐘結(jié)構(gòu)分析及實(shí)現(xiàn)
所屬分類：技術(shù)論文
上傳者：aetmagazine
文檔大小：657 K
標(biāo)簽： Innovus 物理實(shí)現(xiàn) 時(shí)鐘樹(shù)
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文檔介紹：在先進(jìn)工藝節(jié)點(diǎn)下，隨著設(shè)計(jì)規(guī)模越來(lái)越大，時(shí)鐘頻率越來(lái)越高以及時(shí)鐘結(jié)構(gòu)越來(lái)越復(fù)雜，最終整個(gè)設(shè)計(jì)收斂對(duì)于時(shí)鐘質(zhì)量的依賴越來(lái)越明顯。針對(duì)類似多輸入動(dòng)態(tài)mux復(fù)雜時(shí)鐘、IP模塊多內(nèi)部輸出時(shí)鐘等復(fù)雜的時(shí)鐘結(jié)構(gòu)，采用分析時(shí)鐘框圖及基于Innovus工具從網(wǎng)表中提取時(shí)鐘結(jié)構(gòu)的分析方式進(jìn)行時(shí)鐘結(jié)構(gòu)上的詳細(xì)梳理，提出針對(duì)時(shí)鐘結(jié)構(gòu)分析及clock spec的優(yōu)化方法。同時(shí)在一個(gè)超大規(guī)模的16 nm top design上基于優(yōu)化后的clock spec進(jìn)行CTS，并結(jié)合multi-tap的clock tree做法，從得到的結(jié)果可以發(fā)現(xiàn)在run time、clock latency等方面都有較大的提升，能夠滿足項(xiàng)目要求的時(shí)鐘長(zhǎng)度等要求，有效避免block接口的時(shí)序沖突。
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