| 一種嵌入式系統(tǒng)UDPIP協(xié)議棧的優(yōu)化設(shè)計(jì) | |
| 所屬分類：技術(shù)論文 | |
| 上傳者：aet | |
| 文檔大小：1987 K | |
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| 文檔介紹：提出了一種簡(jiǎn)化高效的UDPIP協(xié)議棧的優(yōu)化設(shè)計(jì)方法。從嵌入式系統(tǒng)所要求的高速傳輸效率出發(fā)，優(yōu)化設(shè)計(jì)了協(xié)議棧的BUFFER管理系統(tǒng)、BSD接口、路由模塊以及數(shù)據(jù)重組機(jī)制。從協(xié)議棧的可移植性出發(fā)，實(shí)現(xiàn)了UDPIP協(xié)議棧與標(biāo)準(zhǔn)ETH驅(qū)動(dòng)的掛接，以及同基于其他物理介質(zhì)的虛擬ETH驅(qū)動(dòng)的掛接。與VXWORKS協(xié)議棧的性能對(duì)比結(jié)果表明，本協(xié)議棧具有高效率和低資源占有率，具有很大的實(shí)用價(jià)值。 | |
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