| 基于接口邏輯模型的MCU物理設(shè)計優(yōu)化研究 | |
| 所屬分類：參考設(shè)計 | |
| 上傳者：aet | |
| 文檔大小：457 K | |
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| 文檔介紹：以一款基于TSMC 0.18 μm工藝的MCU芯片WT20為例，采用設(shè)計規(guī)劃的方法在原有的展平式設(shè)計中將ARM Cortex-M0處理器的核心部分分離出來，作為一個接口邏輯模型（ILM）進行設(shè)計，之后在整個設(shè)計的頂層調(diào)入設(shè)計好的接口邏輯模型，完成整個MCU芯片的物理設(shè)計。采用接口邏輯模型的分層次物理設(shè)計與原有的展平式物理設(shè)計相比，設(shè)計耗時顯著縮短。此外，在新的物理設(shè)計中，穿過處理器核心部分的關(guān)鍵路徑在時序方面也有了一定的改善，證明了接口邏輯模型在縮短設(shè)計耗時的同時可以保證時序的正確性。 | |
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