利用開放式行業(yè)標(biāo)準(zhǔn)的創(chuàng)新工具與即插即用 IP，將加速設(shè)計創(chuàng)建、驗(yàn)證、實(shí)施并降低系統(tǒng)功耗全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司（Xilinx, Inc. (NASDAQ:XLNX)）宣布推出 ISE® 13設(shè)計套件。這款屢獲殊榮的設(shè)計工具和 IP 套件新增了許多增強(qiáng)特性，可以提高片上系統(tǒng)（SoC） 設(shè)計團(tuán)隊(duì)的生產(chǎn)力，針對 Spartan®-6、Virtex®-6 和 7 系列 FPGA 以及行業(yè)領(lǐng)先的容量高達(dá) 200 萬個邏輯單元的 Virtex-7 2000T 器件，加速實(shí)現(xiàn)真正的即插即用 IP。針對減少開發(fā)時間和成本，ISE 13設(shè)計套件引入了加速驗(yàn)證、支持 IP-XACT 的即插即用 IP以及全新的Team Design Flow，讓多名工程師利用時序可重復(fù)功能同時開展工作，從而縮短設(shè)計周期。
　
　　由于賽靈思已經(jīng)推出系統(tǒng)門容量高達(dá)數(shù)百萬的 FPGA，例如采用堆疊硅片互連技術(shù) 的Virtex-7 2000T 器件，能夠?qū)⒋小⒉⑿泻蛿?shù)字信號處理融合到一個芯片之上，并提供高達(dá) 28Gbps 的收發(fā)器速度，因此，生產(chǎn)力的需求在這些高度復(fù)雜的設(shè)計中極為重要。
　
　　然而，根據(jù)《國際半導(dǎo)體技術(shù)發(fā)展藍(lán)圖》(International Technology Roadmap for Semiconductors)，若要維持生產(chǎn)力曲線，行業(yè)必須將周期縮短 50%。由于超過一半的設(shè)計周期都花在了驗(yàn)證環(huán)節(jié)上，ISE 13設(shè)計套件采用了新的硬件協(xié)同仿真功能和AMBA®4 AXI4（高級擴(kuò)展接口）總線函數(shù)仿真模型，可以直接提高設(shè)計驗(yàn)證團(tuán)隊(duì)的生產(chǎn)力。
　
加速驗(yàn)證流程
　　利用由開發(fā)板、套件和賽靈思 ISE 仿真器構(gòu)成的賽靈思陣容強(qiáng)大的產(chǎn)品組合，設(shè)計團(tuán)隊(duì)現(xiàn)在可以將仿真運(yùn)行時間從之前的數(shù)小時縮短到幾分鐘。通過實(shí)時仿真，驗(yàn)證工程師可以測試已實(shí)施的設(shè)計模塊，同時把其它開發(fā)中的模塊留在仿真器中，從而將整體驗(yàn)證速度提升至原來的 100 倍（相比原始本地仿真）。新的可選 AXI4 總線函數(shù)模型也可以添加到驗(yàn)證測試平臺，進(jìn)一步加快驗(yàn)證速度，驗(yàn)證客戶提供的 IP 的互聯(lián)邏輯，提高整體生產(chǎn)力。
　
新的Team Design Flow
　　ISE 13設(shè)計套件采用了全新Team Design方法(參見利用Team Design提高生產(chǎn)力)，讓各組開發(fā)人員可以同時工作，解決多名工程師合作開展一個項(xiàng)目時所面臨的挑戰(zhàn)。
　
　　ISE 設(shè)計套件營銷高級總監(jiān) Tom Feist 表示：“設(shè)計片上系統(tǒng)（SoC）非常復(fù)雜，通常是一個國際性開發(fā)團(tuán)隊(duì)共同開展一個設(shè)計項(xiàng)目。不僅HDL的開發(fā)需要動用多名工程師，另外還需要單獨(dú)的工程師扮演整合人員，負(fù)責(zé)整個系統(tǒng)設(shè)計的整合和實(shí)施。而更具挑戰(zhàn)的是開發(fā)不同設(shè)計模塊的團(tuán)隊(duì)可能來自幾個不同的公司。”
　
　　通過完善 ISE 12設(shè)計套件中的設(shè)計保存能力，Team Design Flow可以提供更多功能，確定已完成設(shè)計部分的早期實(shí)施結(jié)果，而無需等待其他設(shè)計團(tuán)隊(duì)。這項(xiàng)全新功能支持高級優(yōu)化，例如智能時鐘門控，它可以降低多達(dá) 30% 的動態(tài)功耗，加快剩余設(shè)計的時序收斂和時序保存，提高整體生產(chǎn)力，減少設(shè)計迭代問題。
　
支持 IP-XACT 的即插即用 IP
　　通過加快設(shè)計重用，ISE 13設(shè)計套件現(xiàn)在可以提供新的符合賽靈思即插即用計劃（參見 AXI4 互連為即插即用 IP 鋪平道路）的開放標(biāo)準(zhǔn)，簡化使用賽靈思和第三方 IP 進(jìn)行的開發(fā)工作，縮短設(shè)計創(chuàng)建時間。該版本新增了AXI 互連配置選項(xiàng)，可以利用稀疏連接模式的 AXI4 互連將互連硅芯片面積減少 50%。高性能的 AXI4 系統(tǒng)可以將客戶的互聯(lián)和內(nèi)存接口系統(tǒng)帶寬提升 20%。現(xiàn)在，用戶可以針對自己的性能或空間面積輕松定制系統(tǒng)，以實(shí)現(xiàn)最佳系統(tǒng)拓?fù)洹?br /> 　
　　另外，賽靈思還為其聯(lián)盟成員提供了新的基于 IP-XACT 的IP Packager，讓聯(lián)盟成員能打包他們自己的 IP，以便在 CORE Generator™ IP 庫之外輕松訪問 IP。IP-XACT 可以為賽靈思及其聯(lián)盟計劃成員的 IP 帶來一致的用戶體驗(yàn)。在 ISE 13設(shè)計套件中，目前已經(jīng)有 50 個賽靈思 IP 內(nèi)核支持 IP-XACT，未來一年之內(nèi)，所有賽靈思 IP 內(nèi)核將全部支持 IP-XACT。未來版本將對客戶開放這一功能，以便他們輕松復(fù)用其IP。 
　
　　賽靈思聯(lián)盟計劃高級成員 Northwest Logic 總裁 Brian Daellenbach 表示：“讓我們的用戶能夠輕松理解和使用我們的 IP，這一點(diǎn)至關(guān)重要。借助 ISE 設(shè)計套件中的新 IP Packager，我們現(xiàn)在就可以為我們的 IP 提供客戶熟悉的CORE GeneratorCORE Generator 環(huán)境，讓客戶能在其設(shè)計中更加快速、更加輕松地配置和使用我們的 IP。”
　
　　為了讓用戶更輕松地仿真加密 IP，賽靈思率先為支持 AXI3 或 AXI4 協(xié)議的 AXI BFM 提供了符合 IEEE P1735 標(biāo)準(zhǔn)的仿真模型，使其與主要的第三方仿真器實(shí)現(xiàn)仿真互操作。面向聯(lián)盟計劃成員的完全符合IEEE P1735標(biāo)準(zhǔn)的全功能加密流程，將于今年晚些時候上市。
　
　　對于無線基帶、視頻和波束成形等要求實(shí)施線性代數(shù)的應(yīng)用，我們在CORE Generator中提供了新的高度可配置的線性代數(shù) LogiCORE™ IP 內(nèi)核。該 IP 內(nèi)核可以實(shí)施各種矩陣運(yùn)算，例如矩陣加法、減法、乘法和矩陣標(biāo)量乘法。
　　
　　ISE 13設(shè)計套件中新增的嵌入式系統(tǒng)設(shè)計處理支持，通過新的高可信MicroBlaze™ 處理器提供。在需要冗余和故障檢測的系統(tǒng)里， MicroBlaze 處理器可以提供內(nèi)存保護(hù)，讓冗余 MicroBlaze 處理器同步作業(yè)，以滿足高可信和可靠性要求。通過在一個易于使用的集成式 IP 模塊中提供處理器和比較器邏輯，設(shè)計人員可以安全地將軟內(nèi)核 MicroBlaze 處理器設(shè)計到各種安全應(yīng)用中，例如經(jīng)常需要錯誤檢查的 ATM 自動柜員機(jī)中。
　
全新文檔導(dǎo)航器 
　　新的賽靈思文檔導(dǎo)航器(Xilinx Documentation Navigator)，可以大大改善賽靈思文檔管理的重要方面，例如查看、發(fā)現(xiàn)、搜索和下載。導(dǎo)航器將賽靈思 FPGA 器件、軟件、板和針對性參考設(shè)計文檔集成到了一個易于使用的環(huán)境當(dāng)中。這款獨(dú)立工具旨在提高客戶的生產(chǎn)力，確保客戶快速找到他們所需的答案。賽靈思文檔導(dǎo)航器下載地址：www.xilinx.com/cn/support/documentation/。
　
供貨情況和定價
　　ISE 13設(shè)計套件 的所有 ISE 版本現(xiàn)已上市，邏輯版本起價 2,995 美元，目前支持 32 位和 64 位 Windows 7。客戶可以從賽靈思網(wǎng)站免費(fèi)下載全功能 30 天試用版。若要立即下載 ISE 13設(shè)計套件，或者詳細(xì)了解 ISE 13設(shè)計套件 的功耗和成本節(jié)省設(shè)計方法與生產(chǎn)力創(chuàng)新特性，請訪問：www.xilinx.com/cn/tools/designtools.htm。