頭條 基于FPGA的ZUC算法快速實現研究 祖沖之（ZUC）算法是我國自主研發的商用序列密碼算法，已被應用于服務器實時運算和大數據處理等復雜需求場景，ZUC的高速實現對于其應用推廣具有重要的實用意義。基于此，針對ZUC適用環境的FPGA實現高性能要求，通過優化模乘、模加等核心運算，并采用流水化結構設計，在FPGA硬件平臺上實現了ZUC算法。實驗結果表明，ZUC算法核的數據吞吐量可達10.4 Gb/s，與現有研究成果相比，降低了關鍵路徑的延遲，提升了算法工作頻率，在吞吐量和硬件資源消耗方面實現了良好的平衡，為ZUC算法的高性能實現提供了新的解決方案。 最新資訊 教學：電可編程邏輯器件EPLD是如何設計的 電可編程邏輯器件（Electrically Programmable Logic Device,EPLD）是指采用電信號的可擦可編程邏輯器件。 發表于：8/25/2022 教學：邏輯綜合工具的工作流程 邏輯綜合工具（Logic Synthesizer）是將數字電路的寄存器傳輸級（RTL）描述經過布爾函數簡化和邏輯優化等步驟自動轉換到邏輯門級網表的工具。 發表于：8/24/2022 Linux教學——Linux設備樹基礎知識 傳輸介質的選擇，無論是PCB材料還是電纜類型，都會對系統性能產生很大的影響。盡管任何傳輸介質在GHz頻率都是有損的，但本章提供了一些管理信號衰減的指南，以便為給定的應用獲得最佳性能。 發表于：8/24/2022 FPGA教學——FPGA中的競爭冒險消除 在FPGA的設計中，毛刺現象是長期困擾電子設計工程師的設計問題之，是影響工程師設計效率和數字系統設計有效性和可靠性的主要因素。由于信號在FPGA的內部走線和通過邏輯單元時造成的延遲，在多路信號變化的瞬間，組合邏輯的輸出常常產生一些小的尖峰，即毛刺信號，也容易引起競爭冒險現象，從而使電路工作的穩定性大受影響。 發表于：8/24/2022 FPGA教學——為什么FPGA主頻比CPU慢，但卻可以用來幫CPU加速？ 我們知道，FPGA的頻率一般只有幾百MHz，而CPU的頻率卻高達數GHz。那么，有不少網友心中就有一個疑問：“為什么FPGA主頻比CPU慢，但卻可以用來幫CPU做加速?”。 發表于：8/23/2022 FPGA教學——STA靜態時序分析 靜態時序分析（簡稱STA）是用來驗證數字設計時序的技術之一，另外一種驗證時序的方法是時序仿真，時序仿真可以同時驗證功能和時序。“時序分析”這個術語就是用來指代“靜態時序分析“或”時序仿真“這兩種方法之一，簡單來說，時序分析的目的就是為了解決設計中的各種時序問題。 發表于：8/23/2022 FPGA教學——FPGA實現IIC協議 這是FPGA之旅設計的第五例啦！今天給大家帶來的是IIC通信，IIC協議應用非常廣泛，例如與MPU6050進行通信，配置OV5640攝像頭、驅動OLED屏幕等等，都需要使用到IIC協議，所以掌握它是非常必要的，廢話不多說，接著往下看。文末獲取完整代碼。 發表于：8/23/2022 Linux教學——Linux進程調度與性能優化 本次分享將從監控和可觀測性、eBPF安全可觀測性分析、內核安全可觀測性展望三個方面展開。 發表于：8/19/2022 Linux教學——探討內核代碼 在HID 1.0之前，是沒有什么OUT 端點的，都是用端點0來進行數據傳輸，不過端點0有一個問題，他的最大傳輸包的大小有限制。 發表于：8/18/2022 Linux教學——一文讀懂Linux內核內存映射與頁表 一文讀懂Linux內核內存映射與頁表 發表于：8/18/2022 ?…17181920212223242526…?
